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徵才說明

  • 工作內容 :
    Physical design implementation, including floorplan, power plan, placement, clock tree synthesis, routing, DRC/LVS to tapeout.
    1. Familiar with Synopsys/Cadence backend design flow.
    2. Hand on APR physical design from netlist to DRC/LVS tapeout experience is
     required.
    3. Experienced in hierarchical implementation, low power design flow, timing
    closure,IR drop analysis, crosstalk/noise analysis.
    4. Familiar with TCL/Perl scripting and design automation.
    5. Experience in 28/16/12nm design is plus.
  • 工作地點 : 新竹市力行路12號 (新竹科學工業園區) (新竹科學園區) 地圖
  • 職務類別 : 半導體工程師  數位IC設計工程師  半導體製程工程師職涯發展地圖
  • 休假制度 : 依公司規定
  • 上班時段 : 08:30~17:30/白天班
  • 職缺更新 : 2019 年 8 月 19 日
  • 需求人數 : 2至3人
  • 薪資待遇 : 面議每月薪資行情表我要申訴
  • 工作性質 : 全職
  • 上班日期 : 隨 時
  • 管理人數 : 不需負擔管理責任
  • 出差說明 : 不需出差

工作條件

  • 學歷要求 : 大學以上
  • 科系要求 : 不拘科系就業導航
  • 工作經驗 : 5 年以上
  • 身份類別 : 一般求職者  
  • 外語能力 :
    英文→  聽:普通  說:普通  讀:普通  寫:普通

技能與求職專長

  • 電腦技能 : 未填寫

其他條件

  • 1.Good skill of cross-team communication.
    2.Master degree majoring in EE/CE/CS related fields.
    3.4+ years of physical design hands on working experience.

徵才特色

  • *上市上櫃

應徵方式

  • 連絡人 : 王筱萍
  • Email : 若有意應徵,請直接按「我要應徵」投遞履歷即可。
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  • 【提醒您】與企業連絡時,請告知「我是在yes123看到此則徵人訊息」,這是一種求職禮儀。
yes123提醒您:前往面試,請留意求職安全
1.求職防騙7不:不繳錢、不購買、不辦卡、不簽約、證件不離身、不飲用、不非法工作
2.求職防騙3要:要有人陪同、要確認公司資料、要存疑:待遇不合理、面試地點偏遠,若遇行為不軌,請立即離開,並向yes123反映 我要申訴